脈寬調(diào)制器誤差放大圖5.10buck電流饋電全橋電路。這里省去了常用的buck輸出濾被電容Cl。圖中畫(huà)有當(dāng)量電容CIV，它是一切主輔輸出電容折算到初級(jí)的電容值。斜對(duì)角的兩個(gè)開(kāi)關(guān)管同時(shí)導(dǎo)通。使行將關(guān)斷的開(kāi)關(guān)對(duì)管和行將導(dǎo)通的開(kāi)關(guān)對(duì)管短時(shí)堆疊導(dǎo)通（lμs）對(duì)電路工作十分有利。行將關(guān)斷的功率開(kāi)關(guān)管和行將導(dǎo)通的開(kāi)關(guān)對(duì)管同時(shí)導(dǎo)通時(shí)，由于LIC未接Cl）呈現(xiàn)高阻抗，橋路一切的輸入、輸出接點(diǎn)電壓均降為零。正是這個(gè)高阻抗使橋路的供電源成為恒流源 。Zl和D8構(gòu)成高端電壓鉗位電路，使后關(guān)斷的開(kāi)關(guān)管關(guān)斷電壓不超越VI與所示電路一樣，該電路用一個(gè)輸入電感替代一切所示電路的輸出電感 。

因而，討論的一切優(yōu)點(diǎn) 。該電路晶體管 Ql Q4  不像圖 5.8 所示電路那樣運(yùn)用調(diào)寬調(diào)制 。兩對(duì)斜對(duì)角的晶體管以 半個(gè)周期輪番導(dǎo)通 ，而且兩者之間不像圖 5.9 所示的 buck 電壓饋電拓?fù)淠菢有枇羲绤^(qū)時(shí)間 。 圖 5.10  所示電路中的每對(duì)晶體管的導(dǎo)通時(shí)間都稍大于半個(gè)周期 。通常經(jīng)過(guò)晶體管的存儲(chǔ)時(shí)間（ 對(duì)慢速管〉 或加一些廷時(shí) （ 對(duì)快速晶體管或 MOSFET 管） 完成。而輸出電壓的調(diào)理是經(jīng)過(guò) 調(diào)理 buck  電路 Q5 的導(dǎo)通脈寬完成的。
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